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数字中国概念再迎崛起契机重磅文件——数字中国规划顶层文件出炉，指明了当下我国经济转型的一大方向。从文件核心内容来看，有两大要点：一是打通数字基础设施大动脉，二是畅通数据资源大循环，核心利好方向将是5G基站、数据中心、软件三大方向，尤其是年报业绩预增的企业。

波特率为9600工程的网盘下载链接：密码：6irgStep1新建工程，调用一个zynq核并配置配置选中这个SD卡，工程做完后会从SD卡启动将这个SDIO设置为50M这里选择一个DDR的型号（不同的开发板有所不同），点击OK完成配置配置完成后的zynq核（这个看起来和配置之前一样）Step2调用axi_uart核并设置波特率点击工具栏的AddIP按钮在弹出的搜索框中输入axi_uart，然后选择这个AXIUartlite核双击添加进来双击这个AXIUartlite核，这里的BaudRate可以选择不同的波特率，我这里选择这个默认的9600（这个波特率可以根据自己的需求选择），其它的选项都保持默认，点击OK完成配置Step3axi_uart进行自动连线将IP核和zynq核连接起来点击这个RunBlockAutomation引出DDR和PS的管脚点击OK如下图所示点击这个RunConnectionAutomation将所有的模块连接起来在弹出的对话框中勾选全部，点击OK连接成功后如下图所示St。

你调用dff1这个程序componentdff1port(rd,d,clk:instd_logic;q:outstd_logic);endcomponent;下面编译的时候就自动会生成顶层文件。一般的FPGA开发需要将你要实现的模块，按照功能划分成一个一个子模块，顶层文件就是将这些小的功能模块连接起来的，以实现你最终的功能。